]> Release 14.2 Trace (nt64)Copyright (c) 1995-2012 Xilinx, Inc. All rights reserved.C:\Xilinx\14.2\ISE_DS\ISE\bin\nt64\unwrapped\trce.exe -intstyle ise -v 3 -s 2 -n 3 -fastpaths -xml top.twx top.ncd -o top.twr top.pcf -ucf top.ucf top.ncdtop.ncdtop.pcftop.pcfxc6slx9C-2PRODUCTION 1.22 2012-07-0913INFO:Timing:3412 - To improve timing, see the Timing Closure User Guide (UG612).INFO:Timing:2752 - To get complete path coverage, use the unconstrained paths option. All paths that are not constrained will be reported in the unconstrained paths section(s) of the report.INFO:Timing:3339 - The clock-to-out numbers in this timing report are based on a 50 Ohm transmission line loading model. For the details of this model, and for more information on accounting for different loading conditions, please see the device datasheet.TS_osc = PERIOD TIMEGRP "tnm_osc" 20 ns HIGH 50%;00000008.000Component Switching Limit Checks: TS_osc = PERIOD TIMEGRP "tnm_osc" 20 ns HIGH 50%;TS_clk_main = PERIOD TIMEGRP "clk_main" TS_osc HIGH 50%;79473529625958298000032320071979473529625954288000046.057Paths for end point Printf/data_tx_2 (SLICE_X19Y27.B6), 233824391111056980000 paths -26.057DS18B20/Mmult_temp_sum[15]_PWR_7_o_MuLt_148_OUTPrintf/data_tx_245.6070.11520.0000.335DS18B20/Mmult_temp_sum[15]_PWR_7_o_MuLt_148_OUTPrintf/data_tx_239DSP48_X0Y1.CLKclk_main_BUFGDSP48_X0Y1.M19Tdspcko_M_B0REG4.371DS18B20/Mmult_temp_sum[15]_PWR_7_o_MuLt_148_OUTDS18B20/Mmult_temp_sum[15]_PWR_7_o_MuLt_148_OUTSLICE_X4Y6.B2net531.193DS18B20/temp_sum[15]_PWR_7_o_MuLt_148_OUT<19>SLICE_X4Y6.BTilo0.254N502DS18B20/temp_sum[15]_PWR_7_o_div_149/o<15>11_SW2SLICE_X4Y8.C1net50.988N502SLICE_X4Y8.CMUXTilo0.430N820DS18B20/temp_sum[15]_PWR_7_o_div_149/o<15>11_1_GDS18B20/temp_sum[15]_PWR_7_o_div_149/o<15>11_1SLICE_X4Y14.A2net81.266DS18B20/temp_sum[15]_PWR_7_o_div_149/o<15>11SLICE_X4Y14.ATilo0.254N1920DS18B20/temp_sum[15]_PWR_7_o_div_149/Mmux_a[0]_a[25]_MUX_1967_o1151SLICE_X5Y4.A4net201.224DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_25_OUT_lut<23>SLICE_X5Y4.ATilo0.259N228DS18B20/temp_sum[15]_PWR_7_o_div_149/Mmux_a[0]_a[25]_MUX_2019_o11011_SW0SLICE_X4Y17.C3net31.583N226SLICE_X4Y17.CTilo0.255DS18B20/temp_sum[15]_PWR_7_o_div_149/Mmux_a[0]_a[25]_MUX_2019_o11211DS18B20/temp_sum[15]_PWR_7_o_div_149/Mmux_a[0]_a[25]_MUX_2019_o1121_2SLICE_X2Y17.D5net40.828DS18B20/temp_sum[15]_PWR_7_o_div_149/Mmux_a[0]_a[25]_MUX_2019_o11211SLICE_X2Y17.CMUXTopdc0.402N2712DS18B20/temp_sum[15]_PWR_7_o_div_149/o<12>1_SW26_FDS18B20/temp_sum[15]_PWR_7_o_div_149/o<12>1_SW26SLICE_X2Y12.B6net10.875N1941SLICE_X2Y12.BTilo0.235DS18B20/temp_sum[15]_PWR_7_o_div_149/a[16]_a[25]_MUX_2029_oDS18B20/temp_sum[15]_PWR_7_o_div_149/Mmux_a[0]_a[25]_MUX_2045_o112SLICE_X9Y20.A1net221.836DS18B20/temp_sum[15]_PWR_7_o_div_149/a[20]_a[25]_MUX_2025_oSLICE_X9Y20.ATilo0.259Printf/hextobcd1/Madd_hex[17]_GND_4_o_add_328_OUT_cy<0>DS18B20/temp_sum[15]_PWR_7_o_div_149/o<11>13SLICE_X0Y13.A6net131.280PrintfData1<11>SLICE_X0Y13.AMUXTopaa0.456N109DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_33_OUT_lut<25>DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_33_OUT_xor<25>SLICE_X5Y11.B3net51.053DS18B20/temp_sum[15]_PWR_7_o_div_149/a[25]_GND_7_o_add_33_OUT<25>SLICE_X5Y11.BTilo0.259N2292DS18B20/temp_sum[15]_PWR_7_o_div_149/Mmux_a[0]_a[25]_MUX_2097_o1171SLICE_X9Y11.C5net130.758DS18B20/temp_sum[15]_PWR_7_o_div_149/a[25]_a[25]_MUX_2072_oSLICE_X9Y11.CTilo0.259DS18B20/temp_sum[15]_PWR_7_o_div_149/a[22]_a[25]_MUX_2075_oDS18B20/temp_sum[15]_PWR_7_o_div_149/o<9>21_SW2_SW0SLICE_X7Y10.B4net90.863N2403SLICE_X7Y10.BTilo0.259DS18B20/temp_sum[15]_PWR_7_o_div_149/o<9>2DS18B20/temp_sum[15]_PWR_7_o_div_149/o<9>23_1SLICE_X8Y12.D5net70.940DS18B20/temp_sum[15]_PWR_7_o_div_149/o<9>23SLICE_X8Y12.DTilo0.254DS18B20/temp_sum[15]_PWR_7_o_div_149/o<8>213DS18B20/temp_sum[15]_PWR_7_o_div_149/o<8>21_3SLICE_X12Y8.B3net71.054DS18B20/temp_sum[15]_PWR_7_o_div_149/o<8>213SLICE_X12Y8.CMUXTopbc0.650DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_39_OUT_cy<13>DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_39_OUT_lut<11>DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_39_OUT_cy<13>SLICE_X10Y5.CXnet201.200DS18B20/temp_sum[15]_PWR_7_o_div_149/a[25]_GND_7_o_add_39_OUT<12>SLICE_X10Y5.CMUXTcxc0.192N2069DS18B20/temp_sum[15]_PWR_7_o_div_149/Mmux_a[0]_a[25]_MUX_2175_o1311_SW0_SW0_SW0_SW0_SW1SLICE_X14Y5.D5net10.991N2069SLICE_X14Y5.COUTTopcyd0.290DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_cy<12>DS18B20/temp_sum[15]_PWR_7_o_div_149/Mmux_a[0]_a[25]_MUX_2175_o1311DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_cy<12>SLICE_X14Y6.CINnet10.003DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_cy<12>SLICE_X14Y6.COUTTbyp0.091DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_cy<16>DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_cy<16>SLICE_X14Y7.CINnet10.003DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_cy<16>SLICE_X14Y7.COUTTbyp0.091DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_cy<20>DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_cy<20>SLICE_X14Y8.CINnet10.082DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_cy<20>SLICE_X14Y8.COUTTbyp0.091DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_cy<24>DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_cy<24>SLICE_X14Y9.CINnet10.003DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_cy<24>SLICE_X14Y9.AMUXTcina0.210DS18B20/temp_sum[15]_PWR_7_o_div_149/o<6>21DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o_add_41_OUT_xor<25>SLICE_X19Y8.A4net30.818DS18B20/temp_sum[15]_PWR_7_o_div_149/a[25]_GND_7_o_add_41_OUT<25>SLICE_X19Y8.ATilo0.259DS18B20/temp_sum[15]_PWR_7_o_div_149/a[22]_a[25]_MUX_2205_oDS18B20/temp_sum[15]_PWR_7_o_div_149/Mmux_a[0]_a[25]_MUX_2201_o1171SLICE_X19Y5.B6net240.910DS18B20/temp_sum[15]_PWR_7_o_div_149/a[25]_a[25]_MUX_2176_oSLICE_X19Y5.BTilo0.259N972DS18B20/temp_sum[15]_PWR_7_o_div_149/o<5>26_SW2SLICE_X18Y7.C3net10.755N64SLICE_X18Y7.COUTTopcyc0.325DS18B20/temp_sum[15]_PWR_7_o_div_149/Madd_a[25]_GND_7_o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149/n1833<14>DS18B20/temp_sum[15]_PWR_7_o_div_149/Mcompar_o<2>_cy<4>SLICE_X21Y13.B4net750.957PrintfData1<2>SLICE_X21Y13.BTilo0.259N1195DS18B20/temp_sum[15]_PWR_7_o_div_149/Mmux_n1833241SLICE_X22Y17.A5net10.863DS18B20/temp_sum[15]_PWR_7_o_div_149/n1833<7>SLICE_X22Y17.COUTTopcya0.495DS18B20/temp_sum[15]_PWR_7_o_div_149/Mcompar_o<1>_cy<3>DS18B20/temp_sum[15]_PWR_7_o_div_149/Mcompar_o<1>_lutdiDS18B20/temp_sum[15]_PWR_7_o_div_149/Mcompar_o<1>_cy<3>SLICE_X22Y18.CINnet10.003DS18B20/temp_sum[15]_PWR_7_o_div_149/Mcompar_o<1>_cy<3>SLICE_X22Y18.AMUXTcina0.240DS18B20/temp_sum[15]_PWR_7_o_div_149/n1728<4>DS18B20/temp_sum[15]_PWR_7_o_div_149/Mcompar_o<1>_cy<4>SLICE_X23Y10.B3net321.325PrintfData1<1>SLICE_X23Y10.BTilo0.259DS18B20/temp_sum[15]_PWR_7_o_div_149/a[21]_a[25]_MUX_2232_oDS18B20/temp_sum[15]_PWR_7_o_div_149/Mmux_n1728251SLICE_X22Y20.B2net11.488DS18B20/temp_sum[15]_PWR_7_o_div_149/n1728<8>SLICE_X22Y20.COUTTopcyb0.448DS18B20/temp_sum[15]_PWR_7_o_div_149/Mcompar_o<0>_cy<3>DS18B20/temp_sum[15]_PWR_7_o_div_149/Mcompar_o<0>_lut<1>DS18B20/temp_sum[15]_PWR_7_o_div_149/Mcompar_o<0>_cy<3>SLICE_X22Y21.CINnet10.003DS18B20/temp_sum[15]_PWR_7_o_div_149/Mcompar_o<0>_cy<3>SLICE_X22Y21.AMUXTcina0.240PrintfData1<0>DS18B20/temp_sum[15]_PWR_7_o_div_149/Mcompar_o<0>_cy<4>SLICE_X22Y24.B5net30.698PrintfData1<0>SLICE_X22Y24.CLKTas0.349Printf/data_tx<1>Printf/data_buffer_index[4]_X_3_o_wide_mux_5_OUT<1>10Printf/data_tx_115.20930.07145.280clk_main_BUFG33.666.4Hold Paths: TS_clk_main = PERIOD TIMEGRP "clk_main" TS_osc HIGH 50%; Paths for end point Printf/tx_bit_count_3 (SLICE_X22Y29.B5), 1 path 0.415Printf/tx_bit_count_2Printf/tx_bit_count_30.4150.0000.0000.000Printf/tx_bit_count_2Printf/tx_bit_count_31SLICE_X22Y29.CLKclk_main_BUFGSLICE_X22Y29.BQTcko0.200Printf/tx_bit_count<2>Printf/tx_bit_count_2SLICE_X22Y29.B5net80.094Printf/tx_bit_count<2>SLICE_X22Y29.CLKTah0.121Printf/tx_bit_count<2>Printf/Mmux_GND_3_o_GND_3_o_mux_21_OUT41Printf/tx_bit_count_30.3210.0940.415clk_main_BUFG77.322.7Paths for end point DS18B20/retd_2 (SLICE_X9Y50.B5), 1 path 0.429DS18B20/retd_3DS18B20/retd_20.4290.0000.0000.000DS18B20/retd_3DS18B20/retd_21SLICE_X9Y50.CLKclk_main_BUFGSLICE_X9Y50.BQTcko0.198DS18B20/retd<4>DS18B20/retd_3SLICE_X9Y50.B5net20.076DS18B20/retd<3>SLICE_X9Y50.CLKTah0.155DS18B20/retd<4>DS18B20/state__n1376<5>1DS18B20/retd_20.3530.0760.429clk_main_BUFG82.317.7Paths for end point DS18B20/retd_5 (SLICE_X8Y50.B5), 1 path 0.432DS18B20/retd_6DS18B20/retd_50.4320.0000.0000.000DS18B20/retd_6DS18B20/retd_51SLICE_X8Y50.CLKclk_main_BUFGSLICE_X8Y50.BQTcko0.234DS18B20/retd<7>DS18B20/retd_6SLICE_X8Y50.B5net20.067DS18B20/retd<6>SLICE_X8Y50.CLKTah0.131DS18B20/retd<7>DS18B20/state__n1376<2>1DS18B20/retd_50.3650.0670.432clk_main_BUFG84.515.5Component Switching Limit Checks: TS_clk_main = PERIOD TIMEGRP "clk_main" TS_osc HIGH 50%;1oscosc46.0573275461675461607947352962595829800000841146.05721.712Fri Feb 13 15:49:37 2015 TraceTrace Settings Peak Memory Usage: 261 MB